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基于深度学习的目标检测研究与应用综述
吕璐;程虎;朱鸿泰;代年树
DOI: 10.16257/j.cnki.1681-1070.2022.0114
摘要
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697
)
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(2133KB)(
362
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可视化
基于深度学习的目标检测算法相较于传统的目标检测算法来说,对复杂场景的稳健性更强,是当前研究的热点方向。根据基于深度学习的目标检测算法的流程特点将其分为两阶段目标检测算法和单阶段目标检测算法,着重介绍了部分经典算法所解决的问题及其优缺点,并梳理了其在工业界的应用情况,最后对其仍存在的问题进行了讨论,对未来可能的发展趋势进行了展望。
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2022年第22卷第1期 pp. 010307
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电流模BUCK DC-DC变换器的系统建模与仿真分析
*
王聪;刘颖异;唐旭升
DOI: 10.16257/j.cnki.1681-1070.2022.0907
摘要
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515
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(1526KB)(
134
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可视化
开关电源转换器是一个闭环网络控制系统,此系统存在高阶、离散、非线性和时变等特性。得到了一个CCM模式下脉冲宽度调制(PWM)控制的电流模BUCK变换器的小信号模型,该模型描述了系统稳态工作时的小信号特性。通过集成电路设计工具Virtuoso,利用AnalogLib库中理想器件得到关于近似函数的小信号模型。通过对小信号模型的稳定性仿真,能够预测电流模式控制的电源变换器的所有小信号特性,包括BUCK次谐波振荡的产生、斜坡补偿和补偿网络对系统稳定性的影响。
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2022年第22卷第9期 pp. 090303
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基于双极型晶体管的温度传感器
阳佳丽, 赵新, 高博, 张析, 龚敏
DOI: 10.16257/j.cnki.1681-1070.2022.0903
摘要
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473
)
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(1589KB)(
200
)
可视化
提出了一种基于双极型晶体管(BJT)宽温度范围的温度传感器。该温度传感器电路通过两个温度特性互补的电流产生一个高斜率的电压,采用电流增益补偿技术和斩波稳定技术来提高传感器输出电压的线性度,同时可通过合理调节电阻值和电流镜比例获得不同的输出电压。在0.18 μm HVCMOS工艺下对传感器进行仿真,结果表明,在-55~125 ℃温度范围内,温度传感器的温度系数为11.2 mV/℃,误差在-0.8~0.8 ℃。
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2022年第22卷第9期 pp. 090301
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一种高增益、高带宽全差分运算放大器的设计
彭春雨;张伟强;蔺智挺;吴秀龙
DOI: 10.16257/j.cnki.1681-1070.2023.0089
摘要
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414
)
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(1035KB)(
246
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可视化
采用增益提升(Gain-boosting)技术,使用2个三输入管的折叠式共源共栅运算放大器(运放)作为辅助运放,设计了一种宽输入共模范围的高增益、高带宽的全差分运算放大器。主运放输入部分由一对NMOS管和一对PMOS管共同构成,其输入跨导提高至由单MOS管构成的运放输入跨导的2倍。主运放输入跨导的提高间接提升了主运放的增益和带宽。而辅助运放在不改变主运放带宽的同时,通过降低主运放的主极点增大输出阻抗,再次提升主运放的增益,达到了高增益、高带宽的目的。该运算放大器采用商用55 nm CMOS工艺设计,经仿真可得,当负载电容为5 pF时,运放低频增益为115 dB,增益带宽积为209 MHz,总功耗为2.8 mW。
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2023年第23卷第7期 pp. 070302
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基于互感开关变压器的毫米波宽带数控振荡器
李幸和, 唐路, 白雪婧
DOI: 10.16257/j.cnki.1681-1070.2023.0130
摘要
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395
)
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(2995KB)(
514
)
可视化
为满足宽频带、高性能的要求,设计了一款V波段毫米波宽带数控振荡器(DCO)。采用基于互感开关变压器的电感调谐技术,通过互感开关控制一组耦合变压器实现双模切换,输出低频子带或高频子带,从而实现宽带设计。采用离散电压控制可变电容器实现离散电容器调谐,与开关电容相比降低了寄生电容和损耗,能够实现更大的带宽和良好的相位噪声。电路基于40nm CMOS工艺设计,核心芯片面积仅为0.053 mm
2
。频率调谐范围为57.85~72.30 GHz,1 MHz频偏处相位噪声范围为-95.32~-91.07 dBc/Hz。
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2023年第23卷第5期 pp. 050308
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一种SATA接口扩展电路的设计与实现
林凡淼;张磊;邓甜甜
DOI: 10.16257/j.cnki.1681-1070.2023.0018
摘要
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337
)
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(1163KB)(
100
)
可视化
信息技术的飞速发展对存储设备的存储容量、传输速率和稳定性等提出了更高的要求。为了满足多种设备之间高速传输的需求,高速串行大容量存储设备规范(SATA)接口作为主流存储设备接口,需要扩展。设计了一种SATA接口扩展电路,基于国产桥片搭建了外围电路及测试平台。详细介绍了硬件设计及测试方法,结果显示,下游5个SATA接口均能连接成功且传输速率均能达到6 Gbit/s,其他外设也均能正常读写。
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2023年第23卷第4期 pp. 040302
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脑电信号传感检测芯片系统综述
*
王梓斌, 刘国柱, 孙建辉
DOI: 10.16257/j.cnki.1681-1070.2022.0512
摘要
(
278
)
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(5760KB)(
277
)
可视化
低电压低频微弱脑电(Electroencephalogram, EEG)信号检测微芯片对于构建可穿戴或可佩戴的EEG检测微设备或系统非常重要。EEG传感检测微芯片可以应用于医学、神经科学以及脑机接口(Brain-Computer Interface, BCI)技术的研究。EEG传感器可以准确、灵敏、安全、可靠地实现微弱低频颅外EEG电压的感知,将感知的信号反馈到传感后调理电路;有效的传感后调理芯片系统可以对前端传感器感知的微弱小信号进行放大、带外信号滤除、噪声抑制或消除等。通过生物模数转化器把放大的模拟EEG电压转换为数字信号,对信号打包并无线发射到远处终端,EEG信号的可靠感知直接影响到EEG接收终端后续EEG算法的有效开展。由于便携可穿戴微型医疗设备或系统的迫切需要,EEG信号传感器与传感后调理芯片的设计变得越来越重要。综述了EEG信号检测微传感器芯片系统国内外的研究进展,主要是通过传感器即EEG电极的信号感知和传感后的EEG信号调理芯片,并对EEG传感器芯片发展进行了总结与展望。
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2022年第22卷第5期 pp. 050302
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一种新型高精度低功耗的张弛振荡器设计
陈天昊, 李富华, 马志寅
DOI: 10.16257/j.cnki.1681-1070.2022.0309
摘要
(
265
)
PDF
(2376KB)(
208
)
可视化
针对传统张弛振荡器精度低的问题,设计了一种低功耗、高稳定度的张弛振荡器。该振荡器由RC充放电模块、有源滤波器模块以及偏置模块组成。采用单比较器实现电位反转,降低整体的功耗,通过使用温度特性相反的电阻混合对温度变化进行补偿,以及有源滤波器产生电压反馈以实现输出时钟信号高精度。采用SMIC 0.18 μm工艺搭建整体电路,并使用Spectre对电路进行仿真。仿真结果显示该电路在宽温度范围(-40~125 ℃)下的频率偏移为0.43%,在1.5~2.5 V电源电压变化范围内,频率变化为0.24%,总电路平均工作电流为19.47 μA。
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2022年第22卷第3期 pp. 030306
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基于RISC-V的神经网络加速器硬件实现
*
鞠 虎, 高 营, 田 青, 周 颖
DOI: 10.16257/j.cnki.1681-1070.2023.0016
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基于初始解优化的FPGA布线方法
惠锋;谢尚銮
DOI: 10.16257/j.cnki.1681-1070.2022.0811
摘要
(
246
)
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(1438KB)(
251
)
可视化
针对自主研发的现场可编程门阵列(FPGA)芯片,提出了一种基于初始解优化的FPGA布线方法。根据逻辑片布线结构,通过简单模式匹配对网表的逻辑单元引脚进行重构来生成低布线拥挤度的初始解,并在布线过程中按节点与漏端相结合的布线策略实现解的快速收敛。实验数据表明,所提方法在全局布线阶段可使拥塞数量下降16.6%,在详细布线阶段可使累计拥塞数量下降9.8%,而且运行时间缩短了7.8%,关键路径裕量提升了17.2%。
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2022年第22卷第8期 pp. 080304
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一种具备MBIST功能的Flash型FPGA配置芯片设计
柯志鸣;党堃原;单宝琛;丛红艳
DOI: 10.16257/j.cnki.1681-1070.2022.1103
摘要
(
232
)
PDF
(2287KB)(
353
)
可视化
Flash型FPGA配置芯片相较于反熔丝配置芯片和可擦除可编程只读存储器(EPROM)型配置芯片,具备非易失性、功耗低、安全性高、可多次编程等更优异的特点。设计了一款具备存储器内建自测试(MBIST)功能的Flash型FPGA配置芯片,在March C?的基础上,提出了一种更全面的测试算法,该算法可以有效提高测试故障覆盖率,并且自身会对测试结果的正确性进行判断,从而快速有效地对Flash功能的正确性进行检验。由于Flash具有非易失性、集成度高等特点,且设计具备MBIST功能,该配置芯片可以满足复杂场景及广泛的应用需求。
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2022年第22卷第11期 pp. 110303
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一种ADC前端无源差分抗混叠滤波器设计
武媛媛;徐克欣;陈丹;徐屹东;李晓林
DOI: 10.16257/j.cnki.1681-1070.2023.0100
摘要
(
231
)
PDF
(1294KB)(
109
)
可视化
高速数据采集系统中,信号采样必须满足奈奎斯特采样定理,否则将产生频率混叠现象,导致无法从采样信号中提取出原始信号。为了消除混叠现象对数据采集系统的影响,设计了一种5阶巴特沃斯型无源差分抗混叠滤波器,使用LTspice仿真软件对滤波器进行仿真,仿真结果表明,所设计滤波器在通带内衰减特性平坦。硬件实测结果显示,系统的无杂散动态范围(SFDR)为84.32dB,所设计的抗混叠滤波器可以有效消除信号混叠现象,并能保持较好的系统动态性能。
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2023年第23卷第4期 pp. 040303
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一种小点间距LED显示屏画面偏色的补偿方法
冯奕;邢向明;周杨
DOI: 10.16257/j.cnki.1681-1070.2022.0101
摘要
(
224
)
PDF
(1428KB)(
159
)
可视化
针对小点间距LED显示屏常见的两种偏色问题,即白平衡偏色和首行偏暗,设计了一种可以同时解决两种问题的电路。由于红绿蓝三种LED的寄生参数不同,使得白平衡偏色。多行扫中第一行扫的列电压较其他列高时,导致第一行的LED导通电流偏低,使得第一行显示效果偏暗。该解决方案对两种情况下的PWM驱动信号进行补偿,并且提供了不同的补偿等级,补偿后,显示画面灰度精准、均匀性高,很好地解决了以上两种问题。
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2022年第22卷第1期 pp. 010304
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基于SiP技术多片DDR3高速动态存储器设计
张小蝶;邱颖霞;许聪;邢正伟
DOI: 10.16257/j.cnki.1681-1070.2022.0108
摘要
(
221
)
PDF
(5085KB)(
206
)
可视化
基于系统级封装技术(System in Package,SiP),结合自研自主可控DSP处理器“魂芯”II-A和多片DDR3颗粒,详细介绍了一款高速动态存储控制一体化SiP设备的设计方案和仿真验证分析结果,重点介绍了此款SiP的电路拓扑设计、版图设计,并从拓扑结构波形仿真、DDR3时序裕量计算和与板级实现方案对比三方面对其PCB后仿进行了分析和验证,仿真结果符合规范要求,证明了所采用的Fly-By拓扑适用于CPU与多片DDR3颗粒所组成的一体化SiP设备,且SiP设备性能优于板级实现方案。
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2022年第22卷第1期 pp. 010302
Select
一种LED显示驱动芯片倍频OS-PWM算法
王震宇, 王雪原, 唐茂洁, 范学仕
DOI: 10.16257/j.cnki.1681-1070.2022.0117
摘要
(
218
)
PDF
(1235KB)(
90
)
可视化
为解决小点间距发光二极管(Light Emitting Diode, LED)显示屏中存在的刷新率较低和低灰显示均匀性差等问题,基于优化打散脉冲调制(Optimize-Scrambled Pulse with Modulation, OS-PWM)算法,采用时钟倍频技术,提出一种倍频OS-PWM算法。基于倍频OS-PWM算法,在不改变总灰度的前提下提高了刷新率,算法复杂度减少一半;对算法进行等级优化,提升了显示均匀性,并在实际样片中得到了验证。
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2022年第22卷第1期 pp. 010306
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Flash型FPGA配置方法研究
庞立鹏;蔺旭辉;马金龙;曹靓;沈丹丹;王晓玲;赵桂林
DOI: 10.16257/j.cnki.1681-1070.2022.0513
摘要
(
218
)
PDF
(1777KB)(
150
)
可视化
Flash型现场可编程门阵列(Field Programmable Gate Array, FPGA)是一种新型非易失性可编程电路,其内核配置单元是Flash单元,配置过程中不需要从外部配置存储器中加载配置数据。为了研究Flash型FPGA的配置方法,设计了应用于30万门Flash型FPGA的配置电路,通过设计研究整体配置电路架构、配置单元模块和控制模块等。对整体电路擦除、编程和校验等操作流程进行验证并对整体功能进行仿真验证,整体电路配置流程和整体综合功能满足设计要求,为后期研究更大系统门规模的Flash型FPGA配置电路奠定了基础。
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2022年第22卷第5期 pp. 050301
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基于FPGA的在线调试软件设计
李卿;董志丹;惠锋
DOI: 10.16257/j.cnki.1681-1070.2022.0203
摘要
(
201
)
PDF
(2113KB)(
136
)
可视化
在线调试在FPGA的设计与开发中不可或缺,而传统的调试方法已无法满足日益发展的FPGA需求。设计了一种基于软核实现在线调试的软件,通过软核实现芯片内信号采集、图形化显示调试信息,并以实际用例详述了在线调试软件对FPGA进行调试的方法和步骤。研究结果表明,该软件具有较好的用户体验、调试效率和调试准确度,对国产化FPGA产业起到积极的推动作用。
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2022年第22卷第2期 pp. 020301
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一款深亚微米抗辐照芯片的设计与实现
邹文英;高丽;谢雨蒙;周昕杰;郭刚
DOI: 10.16257/j.cnki.1681-1070.2022.0709
摘要
(
200
)
PDF
(1071KB)(
179
)
可视化
设计了一款适用于航空航天领域的深亚微米抗辐照四路串口收发电路,重点介绍了逻辑设计、后端设计和抗辐照加固设计。电路采用0.18 μm CMOS工艺加工,使用工艺加固、单元加固及电路设计加固等多层次加固技术,有效地提高了电路的抗辐照能力。
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2022年第22卷第7期 pp. 070304
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装载操作系统国产化板卡复位系统的研究
宁东平;张志强;黄茨
DOI: 10.16257/j.cnki.1681-1070.2022.0613
摘要
(
199
)
PDF
(1367KB)(
241
)
可视化
针对装载操作系统国产化板卡应用时对复位系统的要求,设计了一种复位电路。采用定时器、看门狗与缓冲器的架构,满足国产化板卡加载系统时系统复位信号一直保持高电平的需求。在系统加载完成后,CPU输出喂狗信号,复位系统监控CPU运行。一旦出现死机的情况,CPU被复位,重新加载系统。通过原理分析、电路设计以及原理验证板测试,验证了复位系统设计的合理性与可行性。
参考文献
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2022年第22卷第6期 pp. 060304
Select
基于分解的多路选择器工艺映射方法设计
谢尚銮;惠锋;刘佩;王晨阳;张立
DOI: 10.16257/j.cnki.1681-1070.2022.0807
摘要
(
199
)
PDF
(1299KB)(
120
)
可视化
针对Virtex-7系列FPGA架构,提出了一种基于分解的多路选择器工艺映射方法。选取多个细粒度规则多路选择器作为基准单元,将对应的优质工艺网表保存为模板,将
N
选1多路选择器递归分解为若干层紧密连接的基准单元并基于模板实现其优化映射。对比所提方法与综合工具Vivado及ABC的多路选择器工艺映射效果,实验数据表明该方法与Vivado相比可平均减少1.01%的查找表(LUT)开销与5.61%的时延,与ABC相比可平均减少20.82%的LUT开销与29.51%的时延,而且该方法时间复杂度低,平均运行速度比ABC快4.28倍。
参考文献
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2022年第22卷第8期 pp. 080302
Select
18 bit 20 MS/s流水线ADC架构及行为级模型设计
*
杨迎;黎飞;刘颖异;唐旭升;苗澎
DOI: 10.16257/j.cnki.1681-1070.2022.0206
摘要
(
197
)
PDF
(1349KB)(
131
)
可视化
为了设计出满足高端仪器仪表、电子通信设备等应用需求的高速高精度模数转换器(Analog-to-Digital Converter,ADC),提出了一种精度为18 bit、采样率为20 MS/s的流水线ADC架构。使用Verilog-A语言对每一级流水级中的子模数转换电路(Sub-Analog-to-Digital Converter,Sub-ADC)、乘法数模转换电路(Multiplying Digital-to-Analog Converter,MDAC)等关键电路进行建模,进而搭建出该ADC的整体行为级模型,并基于Cadence的Spectre仿真平台进行仿真验证。在理想情况下,得到的有效位数(Effective Number of Bits,ENOB)为18.01 bit,信噪失真比(Signal to Noise and Distortion Ratio,SNDR)为110.44 dB,无杂散动态范围(Spurious Free Dynamic Range,SFDR)为122.41 dB,验证了所设计的流水线ADC的架构和行为级模型的正确性。在加入运放有限增益、电容失配等非理想因素后,该Verilog-A行为级模型也有效反映出非理想因素对电路性能的影响。将行为级模型与数字校准算法联合仿真,证明了所设计的数字算法能够有效降低非理想因素对电路性能产生的影响。
参考文献
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2022年第22卷第2期 pp. 020304
Select
一种低功耗多模式AB类音频放大器的设计
徐凯英;丁宁;孔祥艺;黄立朝
DOI: 10.16257/j.cnki.1681-1070.2022.1105
摘要
(
196
)
PDF
(866KB)(
154
)
可视化
音频放大器需要兼容耳机和扬声器2种模式,当AB类功率放大器工作在耳机模式时,主运放关断,仅从运放驱动耳机负载,可有效降低放大器的功耗。改进后的AB类音频放大器扬声器模式输出功率为3 W,耳机模式静态功耗为32.5 mW,耳机负载下功耗显著降低,全模式总谐波失真(THD)为0.02%,失真率低、音效品质高。芯片新增了过流保护模块,能够适应不同的负载环境,在小型电子设备中具有良好的应用前景。
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2022年第22卷第11期 pp. 110305
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Ku波段200 W GaN功率放大器的设计与实现
苏鹏;顾黎明;唐世军;周书同
DOI: 10.16257/j.cnki.1681-1070.2022.1112
摘要
(
195
)
PDF
(1188KB)(
124
)
可视化
研制了一款工作在Ku波段的大功率GaN功率放大器,功放采用4个栅宽为9.6 mm的GaN高电子迁移率晶体管(HEMT)进行功率合成,总栅宽为38.4 mm。以提取的小信号
S
参数和大信号负载牵引结果为依据,采用ADS仿真软件进行匹配电路仿真设计。该GaN功放在14.5~15.0 GHz频率范围内的输出功率(
P
out
)大于200 W,功率增益(
G
p
)大于7 dB,最高功率附加效率(
η
PAE
)达到43%。
参考文献
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2022年第22卷第11期 pp. 110307
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基于差分翻转电压跟随器的AB类缓冲器设计
马志寅;李富华;陈天昊
DOI: 10.16257/j.cnki.1681-1070.2022.0402
摘要
(
194
)
PDF
(1200KB)(
181
)
可视化
为了解决传统电压缓冲器建立时间较长、功耗较大等问题,提出了一种基于差分翻转电压跟随器(Differential Flipped Voltage Follower, DFVF)的AB类缓冲放大器。电路主要由作为输入级的差分翻转电压跟随器和基于反相器的输出级组成。与其他缓冲器相比,该电路结构简单,晶体管数量少。由于使用了AB类的缓冲器,因此输出电流不受偏置电流的影响,并且静态电流小。采用SMIC 0.18 μm工艺对电路进行仿真,仿真结果表明在1.8 V电源电压、全电压摆幅下,能在0.56 μs的建立时间内驱动1 nF的电容负载,同时静态电流只有5 μA,可用于液晶显示器的列驱动。
参考文献
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2022年第22卷第4期 pp. 040301
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基于UVM的PCI Express总线控制器验证平台
赵 赛;闫 华;丛红艳;张艳飞
DOI: 10.16257/j.cnki.1681-1070.2022.0212
摘要
(
193
)
PDF
(1581KB)(
280
)
可视化
针对高速外设部件互连(Peripheral Component Interconnect Express,PCIe)总线控制器数据格式复杂、链路状态繁多的特点,提出了基于System Verilog语言的通用验证方法学(Universal Verification Methodology,UVM)验证平台。相较于传统定向验证方法,该验证平台中的验证用例使用受约束的随机方式对PCIe模块进行充分验证,能自动进行结果比对,并在回归测试中自动收集覆盖率数据。结果表明,该验证平台可以快速定位设计缺陷,在兼顾较好的可重用性和可配置性的同时,实现覆盖率验证目标,大大提高验证效率。
参考文献
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多维度评价
2022年第22卷第2期 pp. 020308
Select
基于UVM的MIPI DSI系统级可重用验证平台
周文强
DOI: 10.16257/j.cnki.1681-1070.2022.0806
摘要
(
188
)
PDF
(2953KB)(
118
)
可视化
针对移动产业处理器高速显示串行接口(MIPI DSI),提出了一种基于通用验证方法学(UVM)的系统级可重用验证方法,并设计了相应的验证平台。该平台可重复利用性强,平台中设计的各种组件和测试激励在不同项目中均可重复利用或稍加修改即可利用,大大缩短了验证时间;从系统级上验证,而不是模块级,因此更加接近整体芯片的实际运行过程,能更好地发现设计上的错误;平台中设计的参考模型通过记分板可实时在线比较期望值和实际值,一旦不匹配,立即停止仿真并报告详细的错误信息,便于快速精准定位错误,缩短了调试的时间。实验结果表明,设计的系统级可重用验证平台能够有效验证MIPI,除一些冗余的信号和代码外,覆盖率达到100%。
参考文献
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多维度评价
2022年第22卷第8期 pp. 080301
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13位高无杂散动态范围的SAR ADC
杨志新, Maureen Willis, 高 博, 龚 敏
DOI: 10.16257/j.cnki.1681-1070.2022.0808
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用于Flash型FPGA的电流读出电路
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江燕, 贺春燕, 曹正州, 张艳飞, 徐玉婷, 涂波, 刘国柱
DOI: 10.16257/j.cnki.1681-1070.2023.0017
摘要
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183
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可视化
为了提高Flash型FPGA中的Flash开关单元在编程后驱动能力的一致性,基于 0.11μm 2P8M Flash工艺,设计了一款用于读取Flash开关单元驱动电流的读出电路。该驱动电流的读出电路采用与压控电流源进行多点比较的方式,能够实现对Flash开关单元驱动电流的精确测量,保证了Flash开关单元在编程后阈值电压分布的一致性,为Flash型FPGA的优越的可编程性提供了高精度的延迟参数,将Flash开关单元驱动电流的差异控制在5%之内,满足了Flash型FPGA对Flash开关单元的技术要求。仿真结果表明:在电流为20~40μA的范围内,该驱动电流的读出电路有很高的精度和线性度,读取误差小于1μA。
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2023年第23卷第4期 pp. 040301
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一种低功耗16 bit逐次逼近型ADC的设计
王思远;李琨;叶明远;张涛
DOI: 10.16257/j.cnki.1681-1070.2023.0052
摘要
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139
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可视化
设计了一种低功耗的16 bit 1MSa/s SAR ADC。低功耗设计来源于电容阵列,其由3段子电容阵列构成,之间的桥接电容通过冗余电容和权重电容整数化。在电容阵列的切换过程中,通过将电容分裂来引入额外的参考电压。通过对量化噪声和热噪声的计算,可以精确地得出所需的电容数量为225个单位,相比于传统的电容阵列形式,可以节省99.93%的面积和99.5%的功耗。电路中使用一个2级预放大,并添加了具有自校零功能的动态锁存比较器,确保了高精度分辨率。在UMC55nm工艺下仿真,对512点的FFT仿真结果显示,ADC的整体信噪比(SNR)能够达到85.98dB,有效位数(ENOB)能够达到13.9bit,在电源电压为2.5V的情况下,平均功耗为5.05mW。
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2023年第23卷第5期 pp. 050305
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一种基于扩展汉明码的动态纠错机制
陈天培;吴校生;强小燕
DOI: 10.16257/j.cnki.1681-1070.2022.0507
摘要
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(1702KB)(
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可视化
错误纠正码(Error Correction Code,ECC)是解决存储器数据出现一位或两位错误的一种有效手段,然而过于复杂的编码方式将降低读写性能。为解决该问题,提出了一种基于扩展汉明码的动态纠错机制。利用扩展汉明码的奇偶校验位对检错模块进行了优化,能够监测错误发生的频率,并可动态切换进行扩展汉明码校验与奇偶校验。运用Verilog硬件描述语言实现了该机制并进行了仿真分析。分析结果表明,使用该机制与使用扩展汉明码校验相比,能够有效降低路径延时与动态功耗。
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2022年第22卷第5期 pp. 050304
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